HDL语言仿真器Mentor Graphics ModelSim SE-64 2019.4【Win64】

ModelSim SE是由Mentor公司推出的一款优秀的HDL语言仿真器,提供了友好的调试环境,是唯一的单内核支持VHDL和Verilog混合仿真的仿真器,作FPGA/ASIC设计的RTL级和门级电路仿真的首选,采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术,编译仿真速度快,编译的代码与平台无关,便于保护IP核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段。全面支持VHDL和Verilog语言的IEEE 标准,支持C/C++功能调用和调试。
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Mentor Graphics ModelSim SE-64仿真器为FPGA客户提供了一种简便且经济高效的方式来加快FPGA开发,实验室启动和测试的速度。许多FPGA设计师在对设计进行充分审查之前先去实验室。这意味着实验室中的调试时间可能浪费数周甚至数月。实验室中的测试对设计中信号的可见性有限。放置和路由仪表附加信号或进行小错误修复可能需要8个小时。通过仿真,调试循环要快得多,并且可以完全了解设计中的信号。通过仿真,可以在进入实验室之前进行更高质量的FPGA设计,从而使实验室调试过程中花费的时间更加高效和专注。
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